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解释英文代号：

PC

ALU

IR

MAR

MDR

保存当前欲执行的指令的寄存器称为 (　　) ，保存当前欲执行的指令的地址的寄存器称为程序计数器(　　) 。

计算机的主存容量与有关,

其容量为。

半导体SRAM靠存储信息，

半导体DRAM靠存储信息。

动态RAM的刷新方式通常有、、三种。

如果Cache的容量为128块，在直接映象下，主存中第498块映象到缓存第块。

如果Cache的容量为128块，在直接映射下，主存中第410块映射到缓存第块。

如果Cache的容量为128块，在直接映射下，主存中第354块映射到缓存第块。

存储系统层次结构中，解决CPU和主存速度不匹配问题的是。

存储系统层次结构中，主要解决存储系统容量问题的是。

主存储器容量通常以MB表示，

其中M = ，B = 。

若地址线为20根，字长为32位，按字节寻址空间为，按字寻址空间为。

SRAM芯片6116(2k×8位)有位地址线、位数据线。

一个总线操作周期一般分为4个阶段：

、、

以及。

常见的集中控制优先权仲裁方式、和。

设机器字长为8位，-1的补码在整数定点机中表示为，在小数定点机中表示为。

在小数定点机中，采用1位符号位，若寄存器内容为10000000，当它分别表示为原码、补码和反码时，其对应的真值分别为、和。

已知某8位机的主存采用半导体存储器，地址码为18位，采用4K×4位的SRAM芯片组成该机所允许的最大主存空间，并选用模块条形式，问：(1) 若每个模块条为32K×8位，共需几个模块条？(2) 每个模块条内有多少片RAM芯片?(3) 主存共需多少RAM芯片？CPU需使用几根地址线来选择各模块？使用何种译码器？

假设主存容量为256K*16位，Cache容量为2048*16位，块长为8个16位的字，访存地址为字地址。

（1）在直接映射方式下，设计主存的地址格式。

（2）在全相联映射方式下，设计主存的地址格式。

（3）在二路组相联映射方式下，设计主存的地址格式。

已知x = 0.1101, y = - 0.1011 ，用原码一位乘法计算[x*y]原=？要求写出过程。

[X]原 = 0.1101 [Y]原=1.1011

X* = 0.1101 Y* = 0.1011

数值部分计算：

1 2

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